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PCB設(shè)計(jì)的布局、走線與電磁兼容（二）
日期：2024-09-20 09:38
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摘要：其他方面的要求
48 布局考慮到總體走線的順暢，主要數(shù)據(jù)流向合理。
49 根據(jù)布局結(jié)果調(diào)整排阻、FPGA、EPLD、總線驅(qū)動(dòng)等器件的管腳分配以使布線*優(yōu)化。
50 布局考慮到適當(dāng)增大密集走線處的空間，以避免不能布通的情況。
51 如采取特殊材料、特殊器件（如0.5mmBGA等）、特殊工藝，已經(jīng)充分考慮到到貨期限、可加工性，且得到PCB廠家、工藝人員的確認(rèn)。
52 扣板連接器的管腳對(duì)應(yīng)關(guān)系已得到確認(rèn)，以防止扣板連接器方向、方位搞反。
53 如有ICT測(cè)試要求，布局時(shí)考慮到ICT測(cè)試點(diǎn)添加的可行性，以免布線階段...
其他方面的要求
48 布局考慮到總體走線的順暢，主要數(shù)據(jù)流向合理。
49 根據(jù)布局結(jié)果調(diào)整排阻、FPGA、EPLD、總線驅(qū)動(dòng)等器件的管腳分配以使布線*優(yōu)化。
50 布局考慮到適當(dāng)增大密集走線處的空間，以避免不能布通的情況。
51 如采取特殊材料、特殊器件（如0.5mmBGA等）、特殊工藝，已經(jīng)充分考慮到到貨期限、可加工性，且得到PCB廠家、工藝人員的確認(rèn)。
52 扣板連接器的管腳對(duì)應(yīng)關(guān)系已得到確認(rèn)，以防止扣板連接器方向、方位搞反。
53 如有ICT測(cè)試要求，布局時(shí)考慮到ICT測(cè)試點(diǎn)添加的可行性，以免布線階段添加測(cè)試點(diǎn)困難。
54 含有高速光模塊時(shí)，布局優(yōu)先考慮光口收發(fā)電路。
55 布局完成后已提供1：1裝配圖供項(xiàng)目人對(duì)照器件實(shí)體核對(duì)器件封裝選擇是否正確。
56 開窗處已考慮內(nèi)層平面成內(nèi)縮，并已設(shè)置合適的禁止布線區(qū)。
PCB LAYOUT三種特殊走線技巧
今天小編從直角走線，差分走線，蛇形線三個(gè)方面闡述PCB LAYOUT的走線技巧：
一、直角走線 （三個(gè)方面）
直角走線的對(duì)信號(hào)的影響就是主要體現(xiàn)在三個(gè)方面：一是拐角可以等效為傳輸線上的容性負(fù)載，減緩上升時(shí)間；二是阻抗不連續(xù)會(huì)造成信號(hào)的反射；三是直角**產(chǎn)生的EMI，到10GHz以上的RF設(shè)計(jì)領(lǐng)域，這些小小的直角都可能成為高速問(wèn)題的重點(diǎn)對(duì)象。
二、差分走線 （“等長(zhǎng)、等距、參考平面”）
何為差分信號(hào)（Differential Signal）？通俗地說(shuō)就是驅(qū)動(dòng)端發(fā)送兩個(gè)等值、反相的信號(hào)，接收端通過(guò)比較這兩個(gè)電壓的差值來(lái)判斷邏輯狀態(tài)“0”還是“1”。而承載差分信號(hào)的那一對(duì)走線就稱為差分走線。差分信號(hào)和普通的單端信號(hào)走線相比，*明顯的優(yōu)勢(shì)體現(xiàn)在以下三方面：
1、抗干擾能力強(qiáng)，因?yàn)閮筛罘肿呔€之間的耦合很好，當(dāng)外界存在噪聲干擾時(shí)，幾乎是同時(shí)被耦合到兩條線上，而接收端關(guān)心的只是兩信號(hào)的差值，所以外界的共模噪聲可被完全抵消。
2、能有效抑制EMI，同樣的道理，由于兩根信號(hào)的極性相反，他們對(duì)外輻射的電磁場(chǎng)可以相互抵消，耦合的越緊密，泄放到外界的電磁能量越少。
3、時(shí)序定位**，由于差分信號(hào)的開關(guān)變化是位于兩個(gè)信號(hào)的交點(diǎn)，而不像普通單端信號(hào)依靠高低兩個(gè)閾值電壓判斷，因而受工藝，溫度的影響小，能降低時(shí)序上的誤差，同時(shí)也更適合于低幅度信號(hào)的電路。目前流行的LVDS（low voltage differential signaling）就是指這種小振幅差分信號(hào)技術(shù)。
三、蛇形線 (調(diào)節(jié)延時(shí))
蛇形線是Layout中經(jīng)常使用的一類走線方式。其主要目的就是為了調(diào)節(jié)延時(shí)，滿足系統(tǒng)時(shí)序設(shè)計(jì)要求。其中*關(guān)鍵的兩個(gè)參數(shù)就是平行耦合長(zhǎng)度（Lp）和耦合距離（S），很明顯，信號(hào)在蛇形走線上傳輸時(shí)，相互平行的線段之間會(huì)發(fā)生耦合，呈差模形式，S越小，Lp越大，則耦合程度也越大?？赡軙?huì)導(dǎo)致傳輸延時(shí)減小，以及由于串?dāng)_而大大降低信號(hào)的質(zhì)量，其機(jī)理可以參考對(duì)共模和差模串?dāng)_的分析。下面是給Layout工程師處理蛇形線時(shí)的幾點(diǎn)建議：
1、盡量增加平行線段的距離（S），至少大于3H，H指信號(hào)走線到參考平面的距離。通俗的說(shuō)就是繞大彎走線，只要S足夠大，就幾乎能完全避免相互的耦合效應(yīng)。
2、減小耦合長(zhǎng)度Lp，當(dāng)兩倍的Lp延時(shí)接近或超過(guò)信號(hào)上升時(shí)間時(shí)，產(chǎn)生的串?dāng)_將達(dá)到飽和。
3、帶狀線（Strip-Line）或者埋式微帶線（Embedded Micro-strip）的蛇形線引起的信號(hào)傳輸延時(shí)小于微帶走線（Micro-strip）。理論上，帶狀線不會(huì)因?yàn)椴钅４當(dāng)_影響傳輸速率。
4、高速以及對(duì)時(shí)序要求較為嚴(yán)格的信號(hào)線，盡量不要走蛇形線，尤其不能在小范圍內(nèi)蜿蜒走線。
5、可以經(jīng)常采用任意角度的蛇形走線，能有效的減少相互間的耦合。
6、高速PCB設(shè)計(jì)中，蛇形線沒有所謂濾波或抗干擾的能力，只可能降低信號(hào)質(zhì)量，所以只作時(shí)序匹配之用而無(wú)其它目的。
7、有時(shí)可以考慮螺旋走線的方式進(jìn)行繞線，仿真表明，其效果要優(yōu)于正常的蛇形走線。
PCB技術(shù)中的電磁的兼容性
電磁兼容性（EMC， Electromagnetic Compatibility）是指電子設(shè)備在各種電磁環(huán)境中仍能夠協(xié)調(diào)、有效地進(jìn)行工作的能力。電磁兼容性設(shè)計(jì)的目的是使電子設(shè)備既能抑制各種外來(lái)的干擾，使電子設(shè)備在特定的電磁環(huán)境中能夠正常工作，同時(shí)又能減少電子設(shè)備本身對(duì)其它電子設(shè)備的電磁干擾。印刷電路板（PCB）設(shè)計(jì)中的電磁兼容性涉及多方面因數(shù)，以下主要從三大部分加以闡述，具體選擇要綜合各方面因數(shù)。
一 印刷電路板整體布局及器件布置
1.一個(gè)產(chǎn)品的成功與否，一是要注重內(nèi)在質(zhì)量，二是兼顧整體的美觀，兩者都較**才能認(rèn)為該產(chǎn)品是成功的；在一個(gè)PCB板上，元件的布局要求要均衡，疏密有序，不能頭重腳輕或一頭沉，過(guò)孔要盡量少；電路板的*佳形狀為矩形。長(zhǎng)寬比為3：2或4：3；4 層板比雙面板噪聲低20dB.6層板比4層板噪聲低10dB.經(jīng)濟(jì)條件允許時(shí)盡量用多層板。
2.電路板一般分模擬電路區(qū)（怕干擾），數(shù)字電路區(qū)（怕干擾、又產(chǎn)生干擾），功率驅(qū)動(dòng)區(qū)（干擾源），故步板時(shí)要合理地分成三區(qū)。
3.器件一般選擇功耗低，穩(wěn)定性好的器件，而且盡量少用高速器件。
4.線條有講究：有條件做寬的線決不做細(xì)；高壓及高頻線應(yīng)園滑，不得有尖銳的倒角，拐彎也不得采用直角。地線應(yīng)盡量寬，*好使用大面積敷銅，這對(duì)接地點(diǎn)問(wèn)題有相當(dāng)大的改善。
5.外時(shí)鐘是高頻的噪聲源，除能引起對(duì)本應(yīng)用系統(tǒng)的干擾之外，還可能產(chǎn)生對(duì)外界的干擾，使電磁兼容檢測(cè)不能達(dá)標(biāo)。在對(duì)系統(tǒng)可靠性要求很高的應(yīng)用系統(tǒng)中，選用頻率低的單片機(jī)是降低系統(tǒng)噪聲的原則之一。以8051單片機(jī)為例，*短指令周期1？s時(shí)，外時(shí)鐘是12MHz.而同樣速度的Motorola 單片機(jī)系統(tǒng)時(shí)鐘只需4MHz，更適合用于工控系統(tǒng)。近年來(lái)，一些生產(chǎn)8051兼容單片機(jī)的廠商也采用了一些新技術(shù)，在不犧牲運(yùn)算速度的前提下將對(duì)外時(shí)鐘的需求降至原來(lái)的1/3.而Motorola 單片機(jī)在新推出的68HC08系列以及其16/32位單片機(jī)中普遍采用了內(nèi)部鎖相環(huán)技術(shù)，將外部時(shí)鐘頻率降至32KHz，而內(nèi)部總線速度卻提高到8MHz乃至更高。
6.布線要有合理的走向：如輸入/輸出，交流/直流，強(qiáng)/弱信號(hào)，高頻/低頻，高壓/低壓等……，它們的走向應(yīng)該是呈線形的（或分離），不得相互交融。其目的是防止相互干擾。*好的走向是按直線，但一般不易實(shí)現(xiàn)，*不利的走向是環(huán)形。對(duì)于是直流，小信號(hào)，低電壓PCB設(shè)計(jì)的要求可以低些。所以“合理”是相對(duì)的。上下層之間走線的方向基本垂直。整個(gè)板子的不想要均勻，能不擠的不要擠在一齊。
7.在器件布置方面與其它邏輯電路一樣，應(yīng)把相互有關(guān)的器件盡量放得靠近些，這樣可以獲得較好的抗噪聲效果。時(shí)鐘發(fā)生器、晶振和CPU的時(shí)鐘輸入端都易產(chǎn)生噪聲，要相互靠近些，特別是晶振下方不要走信號(hào)線。易產(chǎn)生噪聲的器件、小電流電路、大電流電路等應(yīng)盡量遠(yuǎn)離邏輯電路，如有可能，應(yīng)另做電路板，這一點(diǎn)十分重要。
二 地線技術(shù)
1.模擬電路和數(shù)字電路在元件布局圖的設(shè)計(jì)和布線方法上有許多相同和不同之處。模擬電路中，由于放大器的存在，由布線產(chǎn)生的極小噪聲電壓，都會(huì)引起輸出信號(hào)的嚴(yán)重失真，在數(shù)字電路中，TTL噪聲容限為0.4V～0.6V，CMOS噪聲容限為Vcc的0.3～0.45倍，故數(shù)字電路具有較強(qiáng)的抗干擾的能力。良好的電源和地總線方式的合理選擇是儀器可靠工作的重要保證，相當(dāng)多的干擾源是通過(guò)電源和地總線產(chǎn)生的，其中地線引起的噪聲干擾*大。
2.數(shù)字地與模擬地分開（或一點(diǎn)接地），地線加寬，要根據(jù)電流決定線寬，一般來(lái)說(shuō)越粗越好（100mil線經(jīng)約通過(guò)1到2A的電流）。地線＞電源線＞信號(hào)線是線寬的合理選擇。
3.電源線和地線盡可能靠近，整塊印刷板上的電源與地要呈“井”字形分布，以便使分布線電流達(dá)到均衡。
4.為減少線間串?dāng)_，必要時(shí)可增加印刷線條間距離，在其安插一些零伏線作為線間隔離。特別是輸入輸出信號(hào)間，
三 去耦、濾波、隔離三大技術(shù)
1.去耦、濾波、隔離是硬件抗干擾常用的三大措施。
2.電源輸入端跨接10~100uf的電解電容器。如有可能，接100uF以上的更好；原則上每個(gè)集成電路芯片都應(yīng)布置一個(gè)0.01pF的瓷片電容，如遇印制板空隙不夠，可每4~8個(gè)芯片布置一個(gè)1~10pF的但電容；對(duì)于抗噪能力弱、關(guān)斷時(shí)電源變化大的器件，如RAM、ROM存儲(chǔ)器件，應(yīng)在芯片的電源線和地線之間直接接入退藕電容；
3.濾波指各類信號(hào)按頻率特性分類并控制它們的方向。常用的有各種低通濾波器、高通濾波器、帶通濾波器。低通濾波器用在接入的交流電源線上，旨在讓50周的交流電順利通過(guò)，將其它高頻噪聲導(dǎo)入大地。低通濾波器的配置指標(biāo)是插入損耗，選擇的低通濾波器插入損耗過(guò)低起不到抑制噪聲的作用，而過(guò)高的插入損耗會(huì)導(dǎo)致“漏電”，影響系統(tǒng)的人身**性。高通、帶通濾波器則應(yīng)根據(jù)系統(tǒng)中對(duì)信號(hào)的處理要求選擇使用。
4.典型的信號(hào)隔離是光電隔離。使用光電隔離器件將單片機(jī)的輸入輸出隔離開，一方面使干擾信號(hào)不得進(jìn)入單片機(jī)系統(tǒng)，另一方面單片機(jī)系統(tǒng)本身的噪聲也不會(huì)以傳導(dǎo)的方式傳播出去。屏蔽則是用來(lái)隔離空間輻射的，對(duì)噪聲特別大的部件，如開關(guān)電源，用金屬盒罩起來(lái)，可減少噪聲源對(duì)單片機(jī)系統(tǒng)的干擾。對(duì)特別怕干擾的模擬電路，如高靈敏度的弱信號(hào)放大電路可屏蔽起來(lái)。而重要的是金屬屏蔽本身必須接真正的地。
48 布局考慮到總體走線的順暢，主要數(shù)據(jù)流向合理。
49 根據(jù)布局結(jié)果調(diào)整排阻、FPGA、EPLD、總線驅(qū)動(dòng)等器件的管腳分配以使布線*優(yōu)化。
50 布局考慮到適當(dāng)增大密集走線處的空間，以避免不能布通的情況。
51 如采取特殊材料、特殊器件（如0.5mmBGA等）、特殊工藝，已經(jīng)充分考慮到到貨期限、可加工性，且得到PCB廠家、工藝人員的確認(rèn)。
52 扣板連接器的管腳對(duì)應(yīng)關(guān)系已得到確認(rèn)，以防止扣板連接器方向、方位搞反。
53 如有ICT測(cè)試要求，布局時(shí)考慮到ICT測(cè)試點(diǎn)添加的可行性，以免布線階段添加測(cè)試點(diǎn)困難。
54 含有高速光模塊時(shí)，布局優(yōu)先考慮光口收發(fā)電路。
55 布局完成后已提供1：1裝配圖供項(xiàng)目人對(duì)照器件實(shí)體核對(duì)器件封裝選擇是否正確。
56 開窗處已考慮內(nèi)層平面成內(nèi)縮，并已設(shè)置合適的禁止布線區(qū)。
PCB LAYOUT三種特殊走線技巧
今天小編從直角走線，差分走線，蛇形線三個(gè)方面闡述PCB LAYOUT的走線技巧：
一、直角走線 （三個(gè)方面）
直角走線的對(duì)信號(hào)的影響就是主要體現(xiàn)在三個(gè)方面：一是拐角可以等效為傳輸線上的容性負(fù)載，減緩上升時(shí)間；二是阻抗不連續(xù)會(huì)造成信號(hào)的反射；三是直角**產(chǎn)生的EMI，到10GHz以上的RF設(shè)計(jì)領(lǐng)域，這些小小的直角都可能成為高速問(wèn)題的重點(diǎn)對(duì)象。
二、差分走線 （“等長(zhǎng)、等距、參考平面”）
何為差分信號(hào)（Differential Signal）？通俗地說(shuō)就是驅(qū)動(dòng)端發(fā)送兩個(gè)等值、反相的信號(hào)，接收端通過(guò)比較這兩個(gè)電壓的差值來(lái)判斷邏輯狀態(tài)“0”還是“1”。而承載差分信號(hào)的那一對(duì)走線就稱為差分走線。差分信號(hào)和普通的單端信號(hào)走線相比，*明顯的優(yōu)勢(shì)體現(xiàn)在以下三方面：
1、抗干擾能力強(qiáng)，因?yàn)閮筛罘肿呔€之間的耦合很好，當(dāng)外界存在噪聲干擾時(shí)，幾乎是同時(shí)被耦合到兩條線上，而接收端關(guān)心的只是兩信號(hào)的差值，所以外界的共模噪聲可被完全抵消。
2、能有效抑制EMI，同樣的道理，由于兩根信號(hào)的極性相反，他們對(duì)外輻射的電磁場(chǎng)可以相互抵消，耦合的越緊密，泄放到外界的電磁能量越少。
3、時(shí)序定位**，由于差分信號(hào)的開關(guān)變化是位于兩個(gè)信號(hào)的交點(diǎn)，而不像普通單端信號(hào)依靠高低兩個(gè)閾值電壓判斷，因而受工藝，溫度的影響小，能降低時(shí)序上的誤差，同時(shí)也更適合于低幅度信號(hào)的電路。目前流行的LVDS（low voltage differential signaling）就是指這種小振幅差分信號(hào)技術(shù)。
三、蛇形線 (調(diào)節(jié)延時(shí))
蛇形線是Layout中經(jīng)常使用的一類走線方式。其主要目的就是為了調(diào)節(jié)延時(shí)，滿足系統(tǒng)時(shí)序設(shè)計(jì)要求。其中*關(guān)鍵的兩個(gè)參數(shù)就是平行耦合長(zhǎng)度（Lp）和耦合距離（S），很明顯，信號(hào)在蛇形走線上傳輸時(shí)，相互平行的線段之間會(huì)發(fā)生耦合，呈差模形式，S越小，Lp越大，則耦合程度也越大?？赡軙?huì)導(dǎo)致傳輸延時(shí)減小，以及由于串?dāng)_而大大降低信號(hào)的質(zhì)量，其機(jī)理可以參考對(duì)共模和差模串?dāng)_的分析。下面是給Layout工程師處理蛇形線時(shí)的幾點(diǎn)建議：
1、盡量增加平行線段的距離（S），至少大于3H，H指信號(hào)走線到參考平面的距離。通俗的說(shuō)就是繞大彎走線，只要S足夠大，就幾乎能完全避免相互的耦合效應(yīng)。
2、減小耦合長(zhǎng)度Lp，當(dāng)兩倍的Lp延時(shí)接近或超過(guò)信號(hào)上升時(shí)間時(shí)，產(chǎn)生的串?dāng)_將達(dá)到飽和。
3、帶狀線（Strip-Line）或者埋式微帶線（Embedded Micro-strip）的蛇形線引起的信號(hào)傳輸延時(shí)小于微帶走線（Micro-strip）。理論上，帶狀線不會(huì)因?yàn)椴钅４當(dāng)_影響傳輸速率。
4、高速以及對(duì)時(shí)序要求較為嚴(yán)格的信號(hào)線，盡量不要走蛇形線，尤其不能在小范圍內(nèi)蜿蜒走線。
5、可以經(jīng)常采用任意角度的蛇形走線，能有效的減少相互間的耦合。
6、高速PCB設(shè)計(jì)中，蛇形線沒有所謂濾波或抗干擾的能力，只可能降低信號(hào)質(zhì)量，所以只作時(shí)序匹配之用而無(wú)其它目的。
7、有時(shí)可以考慮螺旋走線的方式進(jìn)行繞線，仿真表明，其效果要優(yōu)于正常的蛇形走線。
PCB技術(shù)中的電磁的兼容性
電磁兼容性（EMC， Electromagnetic Compatibility）是指電子設(shè)備在各種電磁環(huán)境中仍能夠協(xié)調(diào)、有效地進(jìn)行工作的能力。電磁兼容性設(shè)計(jì)的目的是使電子設(shè)備既能抑制各種外來(lái)的干擾，使電子設(shè)備在特定的電磁環(huán)境中能夠正常工作，同時(shí)又能減少電子設(shè)備本身對(duì)其它電子設(shè)備的電磁干擾。印刷電路板（PCB）設(shè)計(jì)中的電磁兼容性涉及多方面因數(shù)，以下主要從三大部分加以闡述，具體選擇要綜合各方面因數(shù)。
一 印刷電路板整體布局及器件布置
1.一個(gè)產(chǎn)品的成功與否，一是要注重內(nèi)在質(zhì)量，二是兼顧整體的美觀，兩者都較**才能認(rèn)為該產(chǎn)品是成功的；在一個(gè)PCB板上，元件的布局要求要均衡，疏密有序，不能頭重腳輕或一頭沉，過(guò)孔要盡量少；電路板的*佳形狀為矩形。長(zhǎng)寬比為3：2或4：3；4 層板比雙面板噪聲低20dB.6層板比4層板噪聲低10dB.經(jīng)濟(jì)條件允許時(shí)盡量用多層板。
2.電路板一般分模擬電路區(qū)（怕干擾），數(shù)字電路區(qū)（怕干擾、又產(chǎn)生干擾），功率驅(qū)動(dòng)區(qū)（干擾源），故步板時(shí)要合理地分成三區(qū)。
3.器件一般選擇功耗低，穩(wěn)定性好的器件，而且盡量少用高速器件。
4.線條有講究：有條件做寬的線決不做細(xì)；高壓及高頻線應(yīng)園滑，不得有尖銳的倒角，拐彎也不得采用直角。地線應(yīng)盡量寬，*好使用大面積敷銅，這對(duì)接地點(diǎn)問(wèn)題有相當(dāng)大的改善。
5.外時(shí)鐘是高頻的噪聲源，除能引起對(duì)本應(yīng)用系統(tǒng)的干擾之外，還可能產(chǎn)生對(duì)外界的干擾，使電磁兼容檢測(cè)不能達(dá)標(biāo)。在對(duì)系統(tǒng)可靠性要求很高的應(yīng)用系統(tǒng)中，選用頻率低的單片機(jī)是降低系統(tǒng)噪聲的原則之一。以8051單片機(jī)為例，*短指令周期1？s時(shí)，外時(shí)鐘是12MHz.而同樣速度的Motorola 單片機(jī)系統(tǒng)時(shí)鐘只需4MHz，更適合用于工控系統(tǒng)。近年來(lái)，一些生產(chǎn)8051兼容單片機(jī)的廠商也采用了一些新技術(shù)，在不犧牲運(yùn)算速度的前提下將對(duì)外時(shí)鐘的需求降至原來(lái)的1/3.而Motorola 單片機(jī)在新推出的68HC08系列以及其16/32位單片機(jī)中普遍采用了內(nèi)部鎖相環(huán)技術(shù)，將外部時(shí)鐘頻率降至32KHz，而內(nèi)部總線速度卻提高到8MHz乃至更高。
6.布線要有合理的走向：如輸入/輸出，交流/直流，強(qiáng)/弱信號(hào)，高頻/低頻，高壓/低壓等……，它們的走向應(yīng)該是呈線形的（或分離），不得相互交融。其目的是防止相互干擾。*好的走向是按直線，但一般不易實(shí)現(xiàn)，*不利的走向是環(huán)形。對(duì)于是直流，小信號(hào)，低電壓PCB設(shè)計(jì)的要求可以低些。所以“合理”是相對(duì)的。上下層之間走線的方向基本垂直。整個(gè)板子的不想要均勻，能不擠的不要擠在一齊。
7.在器件布置方面與其它邏輯電路一樣，應(yīng)把相互有關(guān)的器件盡量放得靠近些，這樣可以獲得較好的抗噪聲效果。時(shí)鐘發(fā)生器、晶振和CPU的時(shí)鐘輸入端都易產(chǎn)生噪聲，要相互靠近些，特別是晶振下方不要走信號(hào)線。易產(chǎn)生噪聲的器件、小電流電路、大電流電路等應(yīng)盡量遠(yuǎn)離邏輯電路，如有可能，應(yīng)另做電路板，這一點(diǎn)十分重要。
二 地線技術(shù)
1.模擬電路和數(shù)字電路在元件布局圖的設(shè)計(jì)和布線方法上有許多相同和不同之處。模擬電路中，由于放大器的存在，由布線產(chǎn)生的極小噪聲電壓，都會(huì)引起輸出信號(hào)的嚴(yán)重失真，在數(shù)字電路中，TTL噪聲容限為0.4V～0.6V，CMOS噪聲容限為Vcc的0.3～0.45倍，故數(shù)字電路具有較強(qiáng)的抗干擾的能力。良好的電源和地總線方式的合理選擇是儀器可靠工作的重要保證，相當(dāng)多的干擾源是通過(guò)電源和地總線產(chǎn)生的，其中地線引起的噪聲干擾*大。
2.數(shù)字地與模擬地分開（或一點(diǎn)接地），地線加寬，要根據(jù)電流決定線寬，一般來(lái)說(shuō)越粗越好（100mil線經(jīng)約通過(guò)1到2A的電流）。地線＞電源線＞信號(hào)線是線寬的合理選擇。
3.電源線和地線盡可能靠近，整塊印刷板上的電源與地要呈“井”字形分布，以便使分布線電流達(dá)到均衡。
4.為減少線間串?dāng)_，必要時(shí)可增加印刷線條間距離，在其安插一些零伏線作為線間隔離。特別是輸入輸出信號(hào)間，
三 去耦、濾波、隔離三大技術(shù)
1.去耦、濾波、隔離是硬件抗干擾常用的三大措施。
2.電源輸入端跨接10~100uf的電解電容器。如有可能，接100uF以上的更好；原則上每個(gè)集成電路芯片都應(yīng)布置一個(gè)0.01pF的瓷片電容，如遇印制板空隙不夠，可每4~8個(gè)芯片布置一個(gè)1~10pF的但電容；對(duì)于抗噪能力弱、關(guān)斷時(shí)電源變化大的器件，如RAM、ROM存儲(chǔ)器件，應(yīng)在芯片的電源線和地線之間直接接入退藕電容；
3.濾波指各類信號(hào)按頻率特性分類并控制它們的方向。常用的有各種低通濾波器、高通濾波器、帶通濾波器。低通濾波器用在接入的交流電源線上，旨在讓50周的交流電順利通過(guò)，將其它高頻噪聲導(dǎo)入大地。低通濾波器的配置指標(biāo)是插入損耗，選擇的低通濾波器插入損耗過(guò)低起不到抑制噪聲的作用，而過(guò)高的插入損耗會(huì)導(dǎo)致“漏電”，影響系統(tǒng)的人身**性。高通、帶通濾波器則應(yīng)根據(jù)系統(tǒng)中對(duì)信號(hào)的處理要求選擇使用。
4.典型的信號(hào)隔離是光電隔離。使用光電隔離器件將單片機(jī)的輸入輸出隔離開，一方面使干擾信號(hào)不得進(jìn)入單片機(jī)系統(tǒng)，另一方面單片機(jī)系統(tǒng)本身的噪聲也不會(huì)以傳導(dǎo)的方式傳播出去。屏蔽則是用來(lái)隔離空間輻射的，對(duì)噪聲特別大的部件，如開關(guān)電源，用金屬盒罩起來(lái)，可減少噪聲源對(duì)單片機(jī)系統(tǒng)的干擾。對(duì)特別怕干擾的模擬電路，如高靈敏度的弱信號(hào)放大電路可屏蔽起來(lái)。而重要的是金屬屏蔽本身必須接真正的地。
